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mcj/vofa_crc

vofa+软件上位机新增crc校验

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mcj/2021-NJUPT-Analog

2021年南京邮电大学寒假电子设计冬令营模拟方向设计报告

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mcj/FPGA-UART forked from Dr.W.X/FPGA-UART

包含3个独立模块：UART接收器、UART发送器、UART交互式调试器。

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mcj/XY

主要用于XY项目的AD库多人管理

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mcj/myBlog

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mcj/OpenTSN3.2 forked from opentsn/OpenTSN3.2

开源时间敏感网络3.2版本，增加自学习功能

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mcj/OpenTSN4.0 forked from opentsn/OpenTSN4.0

OpenTSN4.0开源项目的新特性：（1）交换平面深度解耦，硬件代码由TSS（时间敏感交换），TSE（时间敏感端），HCP（硬件控制点）和OEM（Opensync MAC）实现。（2）集成了TSN硬件测试工具流量规划生成器TSNBuilder、TSN流量测试仪，用户可根据需要运行OpenTSN4.0交换机、网卡、控制器来进行实验验证。