Verilog编写的RISC-V处理器,支持RV32IM指令集,机器模式,单周期指令,哈佛结构,AXI4-Lite总线。MCU级别的处理器,麻雀虽小,五脏俱全。riscv有无限可能,未来将不断完善,大家的支持是我前进的动力。
最近更新: 3年多前玉衡是一款从零开始写的 RISC-V 内核的处理器,基于 Verilog 硬件设计语言实现,五级流水线设计,支持 RV32IMFD 指令集,支持中断,支持 RT-Thread Nano 3.1.5
最近更新: 3年多前Tools scripts for auto-building openEuler SRPMs for RISC-V
最近更新: 3年多前Open-source high-performance RISC-V processor
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